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Alexander Pfriem

+49 / 931 / 418-2269

alexander.pfriem@vogel.de

EasyStart SmartFusion2/IGLOO2

2-Tages-Seminar (Hands-On)

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Zum Thema

Das Seminar SmartFusion2/IGLOO2 Easy Start schult den Anwender in der grundlegenden Vorgehensweise bei der Entwicklung der FPGAs. Hier findet der Teilnehmer alle notwendigen Basis Informationen um mit der FPGA Entwicklung zu beginnen. Dieses Seminar ist daher für Teilnehmer geeignet die zunächst einen grundlegenden Überblick über die FPGA Entwicklung benötigen ohne detailliert in die theoretischen Grundlagen einsteigen zu müssen.

Ziele

In diesem Seminar wird das Entwicklungstool Libero SoC verwendet. Nach einer kurzen Einführung in die Schaltungstechnik und den Entwicklungsvorgang der FPGAs, konzentriert sich der Workshop auf die Synthese und Simulation, sowie die Implementierung und die Programmierung der FPGAs. Der Schwerpunkt liegt auf der Realisierung von FPGA Projekten und weniger auf detaillierten Beschreibungen der relevanten Arbeitsschritte. Für eine erfolgreiche FPGA Implementierung benötigt der Anwender ein grundlegendes Verständnis für die FPGA Schaltungstechnik, die Beschreibung und Synthese mit VHDL sowie die FPGA Verifikation. Auch muss ein grundlegendes Verständnis der FPGA Technologie vorhanden sein. Im Rahmen dieses Seminars werden verschiedene in der Praxis anzutreffenden Aufgabenstellungen vorgestellt und bearbeitet. Die ordnungsgemäße Funktion der FPGA Entwicklungen wird sowohl mit Hilfe der Simulation als auch real mit einem Evaluation Board nachgewiesen. Detailliertere Inhalte finden Sie auch in den ptek Workshops „smartfusion2_architecture“ oder „libero_soc_design_flow“.

Agenda

  • Overview Libero SoC Design Flow
  • Einführung in den FPGA Entwicklungsvorgang
    • Design Entry
    • Simulation
    • Synthese
    • Implementierung
    • Programmierung
  • FPGA Schaltungstechnik
    • Kombinatorische Schaltungen
    • Getaktete Schaltungen
    • Asynchrone / synchrone Schaltungen
    • Implementierung von Taktstrukturen
    • Design Richtlinien
  • Schaltungssynthese mit VHDL
    • Das VHDL Sprachkonzept
    • Der VHDL Prozess
    • Beschreibung kombinatorischer Schaltungen
    • Beschreibung getakteter Schaltungen
  • SmartFusion2 / IGLOO2 Architecture
    • Overview
  • Interne Takt Strukturen
    • Taktnetze
    • Clock Management
  • Steuerungen implementiert mit State Machines
    • Überblick FSMs
    • Kodierung von State Machines
  • Schaltungssimulation mit VHDL
    • Das VHDL Test Bench Konzept
    • Das VHDL Timing Modell
    • Erzeugung der Stimuli
  • Implementierung von internen Datenspeichern
    • Deklaration von multidimensionalen Arrays
    • Der Coding Style
    • Implementierung der Speicher

Zielgruppe

Das Seminar richtet sich an Neu- und Wiedereinsteiger in der FPGA-Entwicklung.

Seminarmethoden

Zur Bearbeitung der Übungsaufgaben wird jedem Teilnehmer ein PC mit der aktuellen Libero Soc Software sowie Programmiereinrichtungen zur Verfügung gestellt. Die während dem Workshop mit dem Evaluation Board durchgeführten Übungen runden den theoretischen Teil ab. Das Evaluation Board ist im Schulungspreis enthalten.

Voraussetzungen

Grundlegende Kenntnisse SmartFusion2 / IGLOO2 Architektur

Referenten

Eugen Krassin

ptek GmbH | Gründer und Trainer

Eugen Krassin absolvierte ein Studium der Elektrotechnik an der Universität Stuttgart. Nach Abschluss des Studiums arbeitete er mehrere Jahre bei einem Unternehmen aus der Luftfahrtindustrie und befasste sich mit der Entwicklung von kundenspezifischen Schaltungen für AVIONIK Anwendungen.

Ab 1990 arbeitete Eugen Krassin als freier Berater für ASIC/FPGA Entwurf sowie Weiterbildung in diesen Bereichen. Eugen Krassin ist der Gründer von PLC2 GmbH, plc2 Design GmbH sowie ptek GmbH, deren Aufbau und Entwicklung er maßgeblich mitgestaltete.

In den letzten Jahren konzentrierte sich Eugen Krassin hauptsächlich auf ptek sowie den Aufbau der ptek Akademie, eine Initiative zwischen Vogel Business Media und ptek GmbH.

Im Laufe seiner Tätigkeit entwickelte Eugen Krassin mehrere unterschiedliche Schulungsprogramme und Weiterbildungsangebote im Umfeld programmierbare Logik. Er verfasste unzählige Fachartikel und ist Träger verschiedener Auszeichnungen rund um die FPGA Technologien.

Patrick Lehmann

PLC2 GmbH | Externer Trainer

Patrick Lehmann studierte Informatik an der Technischen Universität Dresden. Hier spezialisierte er sich auf den Bereich des digitalen Schaltungsentwurfs mittels VHDL und das Entwickeln von High-Speed Kommunikationslösungen wie Serial-ATA, Gigabit Ethernet oder PCI Express. Das erlangte Wissen gibt er nun in Trainings, wissenschaftlichen Artikeln oder auf sozialen Plattformen weiter. Zu seinen wissenschaftlichen Veröffentlichungen zählen Arbeiten im Bereich der In-Memory Datenbanksysteme, des Serial-ATA Protokolls sowie dem einbinden von FPGAs in eine Cloud Infrastruktur.

Seit 2017 arbeitet Herr Lehmann für die PLC2 GmbH als Trainer in den Bereichen VHDL, OSVVM, FPGA Technologie sowie PCI Express. Im Verbund mit der PLC2 Design GmbH ist er ebenfalls als Entwickler und Teamleiter für FPGA Designprojekte tätig.

Herr Lehmann ist einer der Entwickler und Maintainer der PoC-Library, einer Plattform und Hersteller unabhängigen Open-Source IP Core Bibliothek. Darüber hinaus, ist er Unterstützer und Entwickler im GHDL Projekt, einem freien VHDL Simulator. 2016 gründete er die „Open Source VHDL Group“ Initiative, welche eine freie Sammlung an VHDL Packages bereitstellen soll. Im Rahmen diverser andere Open-Source Projekte treibt er stetig die Integration von EDA Toolchains und Design Flows in eine kollaborative Git Umgebung voran.

Seit 2014 ist Herr Lehmann in der IEEE P1076 "VHDL Analysis and Standardization Group" Mitglied. Hier entwickelte und spezifizierte er große Teile der neuen Sprachrevision VHDL-2018. Seit 2017 ist er der IEEE Standards Assoziation beigetreten und arbeitet nun als Vice-Chair in der IEEE P1076 Working Group. Aktuell koordiniert er mit der IEEE die Veröffentlichung der VHDL Packages als Open-Source, sowie die Untersuchungen zur Einführung einen neuen kollaborativen, sowie Open-Source Veröffentlichungsverfahrens.

Termine

14.03.2019 | 09:00 - 17:00 Uhr
15.03.2019 | 09:00 - 17:00 Uhr

Zur Anmeldeseite
Freiburg im Breisgau

08.07.2019 | 09:00 - 17:00 Uhr
09.07.2019 | 09:00 - 17:00 Uhr

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Frankfurt

05.12.2019 | 09:00 - 17:00 Uhr
06.12.2019 | 09:00 - 17:00 Uhr

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Organisation

Seminarnummer:

5006

Fragen, Wünsche & Anregungen

Alexander Pfriem
Event Manager
E-Mail: alexander.pfriem@vogel.de
Tel:+49 / 931 / 418-2269

Teilnahmegebühr:

1.300,00 € zzgl. MwSt.

In der Teilnahmegebühr sind die Unterlagen, die Getränke, die Pausenerfrischungen, das Mittagessen sowie ein Teilnahmezertifikat enthalten.
Rabattregelung: Wenn Sie gleichzeitig zwei oder mehr Anmeldungen vornehmen, erhalten Sie ab der zweiten Buchung 10 % Rabatt auf den Preis.

Maximale Teilnehmerzahl

Um ein optimales Lernergebnis zu erzielen und den Austausch zwischen Referent und Teilnehmern sowie den Teilnehmern untereinander zu gewährleisten, beträgt die maximale Teilnehmerzahl für dieses Seminar 12 Personen.

Zufriedenheitsgarantie

Sollten Sie bis zur ersten Mittagspause feststellen, dass das Seminar Ihren Erwartungen nicht gerecht wird, dann können Sie es verlassen. Die bereits gezahlte Gebühr erstatten wir Ihnen dann zurück. Bitte informieren Sie uns in diesem Fall umgehend.

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Termine

14.03.2019 - 15.03.2019

08.07.2019 - 09.07.2019Freiburg im Breisgau

05.12.2019 - 06.12.2019Frankfurt

Teilnahmegebühr

1.300,00 € zzgl. MwSt.

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Bitte sprechen Sie mich an, wenn Sie Fragen, Anregungen, Lob oder Kritik zu unseren Seminaren haben.

Alexander Pfriem
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